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多通道任意波形發生器

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更新時間：2024-02-18 13:08:10瀏覽次數：173次

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產品簡介

多通道任意波形發生器HDAWG多通道任意波形發生器AWG在這一級別產品中通道密度相對高，帶寬高達750MHz

詳細介紹

多通道任意波形發生器

HDAWG多通道任意波形發生器AWG在這一級別產品中通道密度相對高，帶寬高達750MHz。HDAWG多通道任意波形發生器有4 / 8個直流耦合，16bit垂直分辨率的單端模擬輸出通道。輸出可以在一個直接模式中單獨切換，具有*的噪聲性能，和一個放大模式將信號振幅提高到值5 Vpp。在保證16位輸出分辨率的同時，保證每通道2個標記設置同步。.

LabOne®軟件基于的編程理念，它結合了AWG的性能和靈活性和函數發生器器的易用性。獨立于平臺的LabOne用戶界面(UI)和虛擬儀器改編LabVIEW，NET，MATLAB，C，和Python支持簡單測量自動化和快速集成到現有的控制環境。

HDAWG關鍵特性

2.4 GSa/s, 16 bit, 750 MHz信號帶寬
5 Vpp 振幅
可擴展到64路輸出通道
高通道密度
Trigger輸出延遲低于50ns
多頻數字調制
LabOne® AWG定序器和編序器

HDAWG應用

核磁共振光譜
半導體測試
MIMO技術

HDAWG多通道任意波形發生器一款儀器，通過擴展核心AWG功能來滿足苛刻的應用程序的要求：附加波形存儲器，函數發生器功能，內部振蕩器，一組脈沖計數器。

量子計算和雷達

多個HDAWG儀器可以自動同步和控制使用單一的用戶界面,使雷達和量子計算系統的有效擴展,同時減少復雜性和實驗室所需的空間。50納秒反應時間短到外部觸發信號使量子糾錯和高保真度的方法。內部振蕩器小化波形上傳時間,確保相位相干性,并提供一個更簡單的波形的定義。綜合脈沖計數器幫助簡化設置捕獲離子和N-V中心實驗。

核磁共振和光譜

MR和其他光譜學應用的信號發生在從納秒到秒的時間尺度上。HDAWG可以通過應用變量采樣率和/或參數掃描來加速這些測量。使用數字調制，可以在一個或多個載波信號上施加一個任意的包絡，并且在不需要額外的努力的情況下保持相位一致。

半導體測試

嵌套排序、波形迭代和動態序列控制是實現大規模高通量測試信號的理想選擇。將AWG信號與函數發生器信號相乘或添加，可以擴展可能性，幫助簡化和加速日常的測量程序。

HDAWG亮點集錦

高水平AWG編程

LabOne UI的設計目的是通過提供一種直觀的、易讀的形式來快速地提供硬件控制。在LabOne AWG音序器中定義了波形和序列之后，LabOne AWG編譯器將指令轉換成機器語言，并在很短的時間內將結果傳輸到硬件。LabOne測序支持動態變化的延遲和條件分支點的循環。

除了標準波形外，如高斯、布萊克曼、sin函數等，LabOne包含復雜波形設計所需的所有必要的數學和陣列編輯工具。您可以輕松地添加、復制、剪切和連接波形或將它們組織成段。從另一個工具(如MATLAB)中計算出的測量信號或波形是一個簡單的拖放操作。

多設備同步

多臺HDAWGs可以作為單一的多通道AWG進行操作：

l 所有儀器使用一個UI/API

l 所有輸出通道同步

l 所有儀器時鐘相位鎖定

l UHF系列儀器的同步時間標記和采樣率

當使用多個儀器時，LabOne AWG編譯器負責將您的主序列程序分布到所有的工具中。自動觸發交換協議確保同步播放時間。使用MDS，你還可以建立一個完整的信號生成和采集系統，包括UHF儀器，包括600MHz器，boxcar, digitizer和AWG功能。

振蕩器，調制，相位控制

HDAWG配備了數字振蕩器，可以獨立于程控的AWG包絡信號產生信號的正弦載波。這意味著可以通過快的波形上傳和許多脈沖的相位相干來生成長信號。將會被寫入靜態波形的載波頻率和相位可以自由調整和掃掠。HDAWG-MF多頻選項增加了振蕩器的數量，使頻率和、頻率多路復用或相位循環實現全數字I/Q調制。在HDAWG-FG函數發生器選項中，調制概念擴展到正弦載波以外的一般載波波形。

低延遲觸發和序列分支

由于低延遲的設計，HDAWG能夠在信號輸出小于50 ns的情況下產生它的個樣本，而在前面板上的一個觸發器輸入中檢測到一個外部觸發器。這對于量子計算的反饋實驗至關重要，因為在量子計算中，設備的性能是短暫的，而每一納秒的保存都極大地提高了實驗結果。儀器的4或8個輸出通道可分為2或4個單元。每一組都可以單獨觸發，在將信號分配到devic的各個部分時增加靈活性。

HDAWG 規格

Arbitrary Waveform Generator
channels	4 (HDAWG4 model) 8 (HDAWG8 model)
vertical resolution	16 bit
waveform memory per channel	64 MSa; 500 MSa (with )
sequence memory	16384 instructions
waveform granularity	8 samples
minimum waveform length	32 samples
sequencer clock frequency	sampling rate divided by 8
sequencer instructions (playback)	play waveform (single or multi-channel), play waveform segment (start sample index and segment length), play waveform from the library (DIO input state), interrupt waveform playback
sequencer instructions (other)	wait constant, wait for trigger, set/get trigger state, set/get DIO state, integer variable operations (add, subtract, logical operations), change oscillator frequency/phase (real-time), change other instrument setting (non real-time)
sequencer control structures	repeat (1 to 2²³-1 or infinite), conditional branch (multi-branch)
Wave Output
connector type	SMA
output impedance	50 Ω
output coupling	DC
output modes	amplified, direct
output range (into 50 Ω)	0.2 to 5.0 V_pp (amplified) 0.8 V_pp (direct)
offset voltage (into 50 Ω)	0.5 × peak voltage, max. ±1.25 V (amplified) 0 V (direct)
phase noise
voltage noise above 200 kHz	30 nV/√Hz (amplified, 5 V_pprange) 12 nV/√Hz (direct)
Time & Frequency Domain Characteristics
frequency range, max. amplitude into 50 Ω	0 ? 300 MHz, 5.0 V_pp 0 ? 750 MHz, 0.8 V_pp
sampling clock source	internal, external
sampling rate	1.5 kSa/s to 2.4 GSa/s (internal clock) 50 MSa/s to 2.4 GSa/s (external clock)
internal sampling clock resolution	7 digits
rise time (20% to 80%)	< 550="" ps="" (amplified,="" 1="" v="" step,="" 5="">_pp output range) < 300="" ps="" (direct,="" 0.8="" v="">
trigger delay to output	< 50="">
skew between channels	< 200="" ps="" (any="" two=""> < 20="" ps="" (channels="" 1&2,="" 3&4,="">
skew adjustment range	10 ns
skew adjustment resolution	10 ps
Marker & Other Outputs
marker outputs	2 per channel, 1 SMA output per channel on front panel, additional outputs on DIO on back panel
sampling clock output	SMA on back panel
sampling clock output amplitude	2 V_pp
reference clock output	SMA on back panel
reference clock output amplitude	1 V_pp
reference clock output frequency	10 / 100 MHz
Inputs
trigger inputs	1 per channel, SMA on front panel
trigger input impedance	50 Ω / 1 kΩ
trigger input amplitude range	±5 V (50 Ω) ±10 V (1 kΩ)
trigger input threshold range	±5 V (50 Ω) ±10 V (1 kΩ)
trigger input threshold resolution	< 0.4="">
sampling clock input	SMA on back panel
reference clock input	SMA on back panel
reference clock input frequency	10 / 100 MHz
Maximum Ratings
damage threshold Sampling Clock input	±5 V
damage threshold Ref input	±5 V
Connectivity & Others
digital IO (DIO)	VHDCI 68 pin female connector, 32 bit, configurable as input or output, 3.3 V TTL
host connection	LAN / Ethernet, 1 Gbit/s USB 3.0, 5 Gbit/s
PC memory requirements	4 GB+
PC CPU requirements	Compatibility with SSE2 instruction set required. Examples: AMD K8 (Athlon 64, Sempron 64, Turion 64, etc.), AMD Phenom, Intel Pentium 4, Xeon, Celeron, Celeron D, Pentium M, Celeron M, Core, Core 2, Core i5, Core i7, Core i3, Atom
operating system	See
General
dimensions	43.0 × 23.2 × 10.2 cm 16.9 × 9.2 × 4.0 inch, suited for 19 inch rack
weight	4.6 kg; 10.2 lbs
power supply AC line	100-240 V (±10%), 50/60 Hz
operating temperature	+5 °C to +40 °C
operating environment	IEC61010, indoor location, installation category II, pollution degree 2
operating altitude	up to 2000 meters